IEEE広島支部では松江テルサにおいて下記の講演会を主催いたします。
ご興味がございます方は是非ともご出席くださいますようお願い申し上げます。
日時：2016年4月14日(木) 15:00 – 16:45
場所：松江テルサ 大会議室（4階）
主催：IEEE広島支部
題目：決済事業（金融マン）から見た最近の潮流
講師：南啓二氏（ソニーペイメントサービス株式会社 取締役執行役員常務）
概要:
スピーカーは大学院で物理化学を専攻しておりましたが、銀行界に就職し、
新規の事業企画や決済事業に20年以上携わっております。最近では、
決済（payment）はFinTechの事業分野として注目されています。
かつて理系の大学院で学んだ者として現在までの職歴の中で感じたことを
お話しさせて頂きます。
参加費：無料
事前の参加申込：不要
本件の問い合わせ先:
山口大学大学院理工学研究科 田村慶信
E-mail: tamura&yamaguchi-u.ac.jp (送信時に&を@に換えてください)
IEEE広島支部では広島市立大学において下記の講演会を後援いたします．
ご興味がございます方は是非ともご出席くださいますようお願い申し上げます．
日時：2016年4月8日（金）14:00～15:30
場所：広島市立大学 情報科学部棟別館6階交流ラウンジ
（広島市安佐南区大塚東3-4-1）
http://www.hiroshima-cu.ac.jp/page/content0005.html
主催：広島市立大学
後援：IEEE広島支部
題目: The Time-Triggered Architecture
講師: Em.Prof. Dr. Hermann Kopetz (Vienna University of Technology)
概要:
The Time-Triggered Architecture (TTA) provides a computing infrastructure for the
design and implementation of dependable distributed embedded systems that is widely
deployed in industry, e.g., in the
Boeing 787 aircraft or the NASA Orion Spacecraft.
A large real-time application is decomposed into nearly autonomous clusters and
nodes, and a fault-tolerant global time base of known precision is generated at
every node. In the TTA, this global time
is used to precisely specify the interfaces among the nodes, to simplify the
communication and agreement protocols, to perform prompt error detection, and to
guarantee the timeliness of real-time app
lications. The TTA supports a two-phased design methodology, architecture design,
and component design. During the architecture design phase, the interactions among
the distributed components and the
interfaces of the components are fully specified in the value domain and in the
temporal domain. In the succeeding component implementation phase, the components
are built, taking these interface spec
ifications as constraints. This two-phased design methodology is a prerequisite for
the composability of applications implemented in the TTA and for the reuse of
prevalidated components within the TTA
. This talk presents the architecture model of the TTA, explains the design
rationale, discusses the time-triggered communication protocols TTP/C and
TT-Ethernet, and illustrates how transparent fault
tolerance can be implemented in the TTA.
参加費：無料
事前の参加申込：不要
本件の問い合わせ先:
広島市立大学 角田良明 TEL:082-830-1696
E-mail: kakuda&hiroshima-cu.ac.jp (送信時に&を@に換えてください）